CXL(Compute Express Link)を一言で言えば、**「CPU、アクセラレータ(GPU等)、メモリを、まるで一つの大きな机の上にあるかのように高速かつ効率的に繋ぐための新しい共通規格」**です。
従来のPCI Express(PCIe)という「高速道路」の上に、メモリ管理に特化した「専用レーン」を追加したような仕組みになっています。
主な仕組みと特徴を3つのポイントで解説します。
1. 3つのプロトコル(通信手順)の組み合わせ
CXLは、PCIe 5.0/6.0の物理的な仕組み(コネクタや電気信号)をそのまま使いながら、用途に合わせて3つのプロトコルを動的に使い分けます。
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CXL.io:従来のPCIeと同じ役割。デバイスの認識や初期設定、データの転送を行います。
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CXL.cache:アクセラレータ(GPUなど)が、CPUのメモリを自分のキャッシュのように直接覗きに行けるようにします。
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CXL.mem:CPUが、外部に繋がったデバイス上のメモリを、自分のメインメモリと同じように読み書きできるようにします。
2. 「キャッシュコヒーレンシ(一貫性)」の維持
これがCXLの最大の技術的ポイントです。
通常、CPUとGPUがそれぞれ独自のメモリを持っていると、片方がデータを書き換えても、もう片方は古いデータを持ったままになってしまいます。これを防ぐために複雑なソフトウェア処理が必要でしたが、CXLはハードウェアレベルでデータの整合性を自動で保ちます(コヒーレンシ)。
これにより、データの移動やコピーという無駄な作業(オーバーヘッド)が劇的に減り、処理が高速化します。
3. メモリの「プーリング(共有化)」
これまでのサーバーでは、メモリは各マザーボードに固定されていました。CXLを使うと、**「メモリだけが入った箱」**を外部に置き、複数のサーバーでそのメモリを分け合うことができます。
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無駄の解消: Aサーバーでメモリが余り、Bサーバーで足りないという時、CXL経由で柔軟に割り当てを変更できます。
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大容量化: スロットの物理的限界を超えて、テラバイト級のメモリ拡張が容易になります。
CXLによる「デバイスの3つの分類」
CXL規格では、接続されるデバイスを役割に応じて3つのタイプに分けています。
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Type 1 (SmartNICなど): 主にCXL.ioとCXL.cacheを使用。ホストのメモリを効率的に利用します。
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Type 2 (GPU, FPGA): 全てのプロトコルを使用。CPUとアクセラレータが互いのメモリを共有して計算します。
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Type 3 (メモリ拡張モジュール): 主にCXL.ioとCXL.memを使用。単純に「外付けの高速メモリ」として機能します。
まとめ
CXLの登場により、これまで「CPUの付属品」だったメモリが、システム全体で共有できる**「巨大なリソースプール」**へと進化しました。これにより、巨大なデータを扱う生成AIなどの処理能力が飛躍的に向上しています。
出典:Google Gemini
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