IIP2の確保と回路の平衡度（Balance）

マルチオクターブ環境において、**IIP2（2次入力インターセプト・ポイント）**の確保は、システムのSFDRを維持するための最重要課題です。

3次歪み（IMD3）がデバイス自体の物理的な非線形性（飽和特性）に依存するのに対し、2次歪み（IMD2）は**「回路の非対称性（Imbalance）」**に依存するという性質があります。

1. 平衡度（Balance）とIMD2の関係

理想的な差動（ディファレンシャル）回路では、2次高調波や2次相互変調歪みは同相信号として現れるため、合成時に完全にキャンセルされます。しかし、現実の回路では以下の不完全性がIMD2を発生させます。

振幅誤差（Amplitude Imbalance）: 差動ペアのパス間でゲインに差がある。
位相誤差（Phase Imbalance）: パス間で遅延差（180度からのズレ）がある。

改善のメカニズム

差動出力 $V_{out}$ は、各パスの出力を $V_a, V_b$ とすると $V_{out} = V_a - V_b$ となります。

入力 $x(t)$ に対して2次歪み成分 $ax^2(t)$ が発生する場合、完全な対称性があれば：

(ax^2) - (ax^2) = 0

となりますが、わずかでも非対称があるとこの差分がスプリアスとして残留します。

2. IIP2を確保するためのハードウェア設計

IIP2を最大化するためには、信号経路の「対称性」を極限まで高める必要があります。

A. バラン（Balun）の選定

シングル端から差動へ変換するバランの性能が、システム全体のIIP2を規定することが多々あります。

振幅バランス: 通常 0.1dB 以下の精度が求められます。
位相バランス: 1度以内の誤差に抑える必要があります。
広帯域設計では、周波数によってこのバランスが崩れるため、使用帯域全体での特性確認が不可欠です。

B. レイアウトの対称性

基板設計（PCB）において、差動ラインの長さ、ビアの数、周囲のグラウンド・プレーンとの結合を完全に一致させます。

ペア間のアイソレーション: 隣接信号からの結合も非対称の原因となります。
熱勾配の考慮: デバイス内の温度差もパラメータのミスマッチを誘発します。

3. 回路トポロジーによるアプローチ

ミキサーの選択

パッシブ・ミキサー: 一般にアクティブ・ミキサー（ギルバート・セル型など）よりも高いIIP2を得やすい傾向にあります。これは、アクティブ素子のDCバイアス点に起因するミスマッチの影響を受けにくいためです。
ダブルバランス型 / トリプルバランス型: 局所発振（LO）リークの抑制とともに、2次歪みのキャンセル能力に優れています。

4. デジタル支援による校正（Calibration）

ハードウェアの物理的な対称性だけで十分なIIP2（例：+70dBm以上）を得るのが難しい場合、デジタル補正が併用されます。

DCオフセット補正: ゼロIFレシーバーにおいて、IMD2（ $f_2 - f_1$ ）はDC付近に現れるため、これをリアルタイムでモニタリングし、アナログ段のバイアスを微調整（トリミング）してキャンセルします。
LMSアルゴリズム: ベースバンド側で2次歪みのレプリカを生成し、受信信号から差し引くことで、実効的なIIP2を10〜20dB程度改善することが可能です。

まとめ：設計の優先順位

項目	対策内容	期待できる効果
フロントエンド	高性能バラン、高線形性LNA	入力段でのIMD2発生を最小化
回路構成	完全差動化、パッシブ・ミキサー	偶数次歪みの物理的な相殺
PCBレイアウト	等長・等幅・対称配置	位相・振幅バランスの維持
キャリブレーション	デジタル適応フィルタ、バイアス調整	残留スプリアスの除去

マルチオクターブ設計においては、**「IIP2はレイアウトとバランスで稼ぐ」**というのがエンジニアリングにおける鉄則と言えます。

出典：Google Gemini (Gemini は AI であり、間違えることがあります。)

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