原子層堆積(ALD: Atomic Layer Deposition)は、ナノシートFETやCFETといった、ナノメートル単位の立体構造を持つ次世代デバイスを製造する上で「生命線」となる成膜技術です。
RFや電子回路の世界で例えるなら、極細の同軸ケーブルの内部に、ムラなく均一な絶縁体を分子1層レベルの精度でコーティングしていくような、驚異的な精密さが特徴です。
1. ALDの基本原理:自己制御プロセス
ALDは、一般的なCVD(化学気相成長)とは異なり、原料となるガス(前駆体:プレカーサー)を1種類ずつ順番に投入し、化学反応を1サイクルずつ繰り返す手法です。
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プレカーサーの吸着: 最初のガスを供給し、基板表面に「分子1層分」だけを飽和吸着させます(これ以上は吸着しない「自己停止機能」が働きます)。
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パージ: 余剰なガスを不活性ガスで追い出します。
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反応ガスの供給: 2番目のガスを入れ、吸着している分子と化学反応させて、目的の膜を1層形成します。
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パージ: 再度、余剰分を追い出します。
2. なぜ先端プロセス(高NA EUV / CFET)にALDが必要なのか?
抜群の段差被覆性(コンフォーマル性)
CFETのような「深い溝」や「ナノシートの隙間(裏側)」に対しても、ガスが入り込みさえすれば、表面に均一な厚さの膜を形成できます。
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スパッタリング等の課題: 物理的に飛ばす手法では、影になる部分に膜がつきません。
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ALDの優位性: 立体構造の「裏側」まで、設計通りの厚さ(nm単位)で膜を張ることができます。
膜厚の原子レベル制御
1サイクルで積層される厚さが決まっているため、サイクルの回数を管理するだけで、膜厚を原子層レベルで完璧に制御できます。これは、トランジスタの閾値電圧を決定する「ゲート絶縁膜(High-k)」の形成において、極めて重要な精度です。
3. 次世代デバイスにおける具体的活用シーン
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Gate-All-Around (GAA) のゲート絶縁膜: ナノシートを全周から囲むゲート酸化膜(HfO2など)の形成。
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CFETの中間絶縁: 垂直に積層されたn型とp型の間の、極めて狭い隙間を絶縁物で充填。
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エリア選択的ALD (AS-ALD): 2026年現在の最先端研究では、特定の素材(例えば金属の上だけ)に反応し、他の場所(絶縁体の上)には膜を形成しない「自己整合型」の成膜技術も開発されており、リソグラフィの限界を補完しています。
4. 製造技術としてのトレードオフ
非常に優れた技術ですが、量産における課題もあります。
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成膜スピードの遅さ: 1層ずつガスを入れ替えるため、通常のCVDに比べて時間がかかります。
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スループット向上の工夫: 2026年現在、多くのウェハを一括処理する「バッチ式ALD」や、ステージを回転させてガス領域を通過させる「空間分割ALD(Spatial ALD)」などの高速化技術が導入されています。
技術的なアナロジー
ALDは、ペンキを吹き付ける(スプレー)のではなく、「1枚ずつ薄いシールを隙間なく、物理的な限界まで丁寧に貼り重ねていく」ような作業です。
この技術がなければ、ナノシートFETもCFETも、その複雑な3次元構造を機能させることは不可能です。RF回路の設計においても、将来的にこうした「原子レベルでの製造精度」を前提とした、寄生容量の極めて安定したデバイスモデルが利用できるようになると期待されます。
ALDと対になる「原子層エッチング(ALE)」や、それらを組み合わせた「自己整合型プロセス」についても興味がありますか?
出典:Google Gemini (Gemini は AI であり、間違えることがあります。)
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